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數(shù)字電路與系統(tǒng)設(shè)計(jì) 張順興 主編 目 錄 第1章 數(shù)制與碼制 1.0 緒論 1.1 數(shù)制 1.2 碼制（編碼的制式） 第1章 習(xí)題 第2章 邏輯代數(shù)基礎(chǔ) 2.1 概述 2.2 邏輯代數(shù)中的運(yùn)算 2.3 邏輯代數(shù)的公式 2.4 邏輯代數(shù)的基本規(guī)則 2.5 邏輯函數(shù)的表達(dá)式 2.6 邏輯函數(shù)的化簡 2.6 邏輯函數(shù)的化簡 2.6 邏輯函數(shù)的化簡 第2章 習(xí)題 第4章 組合邏輯電路 4.1 SSI構(gòu)成的組合邏輯電路的分析和設(shè)計(jì) 4.2 中規(guī)模集成組合邏輯電路 4.2 中規(guī)模集成組合邏輯電路 4.2 中規(guī)模集成組合邏輯電路 4.3 競爭和冒險(xiǎn) 第4章 習(xí)題 第5章 觸發(fā)器（Flip Flop） 5.1 概述 5.2 基本SRFF(SDRDFF) 5.3 鐘控電位觸發(fā)器（鐘控觸發(fā)器） 5.3 鐘控電位觸發(fā)器（鐘控觸發(fā)器） 5.4常用觸發(fā)器 5.4常用觸發(fā)器 5.5 CMOS FF 5.6 觸發(fā)器邏輯功能的轉(zhuǎn)換 第5章 觸發(fā)器習(xí)題 第6章 時(shí)序邏輯電路 6.1 概述 6.2 時(shí)序電路的分析 6.3 時(shí)序電路的設(shè)計(jì) 6.4 寄存器和移存器 6.5 計(jì)數(shù)器 6.5 計(jì)數(shù)器 6.5 計(jì)數(shù)器 6.6 序列碼發(fā)生器 6.7 順序脈沖發(fā)生器 第6章習(xí)題 第9章 半導(dǎo)體存儲(chǔ)器 9.0 概述 9.1 只讀存儲(chǔ)器（ROM） 9.1 只讀存儲(chǔ)器（ROM） 9.2 隨機(jī)存儲(chǔ)器(RAM) 第9章 習(xí)題 第10章 可編程邏輯器件 10.1 PLD概述 10.2 PLD的基本結(jié)構(gòu) 10.3 PLD的表示方法 10.4 PLD的分類 10.5 可編程邏輯陣列（PLA） 10.6 可編程陣列邏輯（PAL） 10.7 通用陣列邏輯（GAL） 10.8 現(xiàn)場(chǎng)可編程門陣列FPGA 第十一章 硬件描述語言VHDL 11.1 概述 11.2 VHDL基本結(jié)構(gòu) 11.3 VHDL語言元素 11.4 VHDL常用編程語句 11.5 基本邏輯電路設(shè)計(jì) 第12章 數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ) 12.0 數(shù)字系統(tǒng)概念及設(shè)計(jì)方法 12.1 概述 12.1 概述 12.2 寄存器傳輸語言(RTL) 12.3 數(shù)字系統(tǒng)設(shè)計(jì)的其他描述工具 12.3 數(shù)字系統(tǒng)設(shè)計(jì)的其他描述工具 12.4 數(shù)字系統(tǒng)設(shè)計(jì)舉例 12.4 數(shù)字系統(tǒng)設(shè)計(jì)舉例 12.5 PLD在數(shù)字系統(tǒng)設(shè)計(jì)中的應(yīng)用 12.5 PLD在數(shù)字系統(tǒng)設(shè)計(jì)中的應(yīng)用 12.6 VHDL實(shí)現(xiàn)數(shù)字系統(tǒng)舉例rrk紅軟基地

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